AMD는 인터 포저로 epyc rome 메모리 문제를 해결할 수 있습니다

AMD 는 최대 4 개의 8 코어 Zeppelin 어레이 모듈 인 EPYC 비즈니스 프로세서를 통해 데이터 센터 시장에서 경쟁력을 회복했습니다. 각 어레이에는 자체 내장 노스 브리지가 있으며 2 채널 DDR4 메모리 및 32 웨이 PCI-Express Gen 3.0 루트 컴플렉스를 제어합니다. 메모리 대역폭을 많이 사용해야하는 응용 프로그램 에서이 지역화되지 않은 메모리 방식은 새로운 로마에서 해결 될 디자인 병목 현상을 나타냅니다.

AMD EPYC Rome은 모 놀리 식 메모리 설계

Ryzen Threadripper WX 프로세서 제품군은 이러한 많은 병목 현상을 강조 합니다. 많은 메모리를 필요로하는 비디오 인코딩 응용 프로그램의 경우 성능 저하는 직접 I / O 액세스 폭이없는 어레이로 간주됩니다 메모리 밴드의. 이 문제에 대한 AMD의 솔루션은 노스 브리지가 비활성화 된 CPU 다이를 설계하는 것입니다.이 솔루션은 코드 명 " 로마 "인 차세대 EPYC 프로세서에서 구현 될 수 있습니다.

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AMD의 차세대 MCM은 다이로 둘러싸인 중앙 집중식 시스템 컨트롤러 디자인을 볼 수 있습니다.이 시스템 컨트롤러는 모두 Vega 10 및 Fiji GPU에서와 같은 유형 의 실리콘 인터 포저에있을 수 있습니다. 인터 포저는 MCM의 매트릭스 사이의 고밀도 미세 배선을 용이하게하는 실리콘 매트릭스입니다. 현재 세대 EPYC 프로세서와 달리이 메모리 인터페이스는 인텔 구현과 매우 유사합니다.

시스템 컨트롤러는 또한 최대 6 개의 x16 대역폭 그래픽 카드를 처리하거나 x8에서 최대 12 개의 복잡한 PCI-Express gen 4.0 x96 루트를 제공합니다. 이 매트릭스는 서버 컨트롤러 허브라고도하는 사우스 브리지를 통합하여 SATA, USB 및 기타 레거시 저 대역폭 I / O와 같은 일반적인 I / O 인터페이스와 몇 가지 다른 PCIe 라인을 구현합니다.

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